引言

在涉及Xilinx Zynq UltraScale+ MPSoC的項目中，實現設備間高速、低延遲的數據傳輸往往是核心需求之一。PCIe（尤其PS側）結合DMA（直接內存訪問）正是滿足這類需求的理想技術方案。

在近期支持的客戶項目中，其核心需求在于：在一款PCB單板上，集成兩顆Zynq MPSoC器件，并利用其PS側的PCIe控制器，直接構建點對點DMA數據傳輸鏈路，從而避免引入額外的PCIe交換芯片。為了驗證該方案的可行性并積累經驗，我們使用兩塊ZCU102開發板成功搭建并測試了一個工作Demo。

這篇文章將聚焦這一實戰過程，手把手帶你完成：環境搭建、硬件配置、驅動移植、系統編譯到最終的上板測試驗證，目標是幫你快速在你的MPSoC項目上實現類似的高速DMA互連！

一、實戰準備：軟硬件環境搭建

1.1硬件準備

開發板：兩塊Xilinx ZCU102開發板。

連接線：一根PCIe公對公延長線纜。

角色分配

板卡1：配置為RC（Root Complex）。

板卡2：配置為EP（Endpoint）。

物理連接：將兩塊板的PS側PCIe插槽通過延長線纜直接相連（如下圖所示）。

1.2 軟件準備

軟件版本

Vivado：2021.2（用于硬件設計和比特流生成）。

PetaLinux：2021.2（用于嵌入式Linux系統構建）。

1.3 驅動準備

（Xilinx PCIe Root and EndPoint - Xilinx Wiki - Confluence[1]）我們需對其進行交叉編譯以生成適用于ARM64架構的內核模塊（.ko）。

注：

[1]https://xilinx-wiki.atlassian.net/wiki/spaces/A/pages/85983409/Xilinx+PCIe+Root+and+EndPoint（復制到瀏覽器打開）

二、詳細實現過程拆解

2.1 硬件設計（RC端配置-Vivado）

① 創建block design后，添加“Zynq Ultrascale+ MPSoC” IP。

② 運行Block automation，進行基礎配置。

③ 注意將自動生成的“maxihpm0_fpd_aclk”和“maxihpm1_fpd_aclk”與“pl_clk0”連線，否則會導致后面validate不通過。

④ Vivado通常已自動分配管腳，默認模式為RC，使用GT Lane 0。在“IO Configuration”的頁面可以看到，PCIE默認配置為Gen2 x1，其他GT Lane分別配置給DP/USB3.0/SATA。本實驗使用默認配置。

⑤ PCIE高級配置，勾選“Switch To Advanced Mode”。

確保Class Code值設置為0x060400（代表PCI-to-PCI Bridge）。如果使用錯誤的類代碼，Linux在枚舉時可能導致BAR分配失敗！其余高級配置一般可用默認值。

⑥ 配置完成后，按照“Generate Output Products” ->“Create HDL Wrapper”->“Generate Bitstream”的流程。成功生成比特流后，導出.xsa文件，用于PetaLinux系統構建。

2.2 構建Linux系統（RC端-Petalinux）

① petalinux工程創建

petalinux-create --type project -s xilinx-zcu102-v2021.2-final.bsp -n zcu102_rc

② 導入硬件描述（.xsa）

petalinux-config -- get-hw-description = （path of zcu102_rc.xsa）

③ 配置Linux內核

petalinux-config -c kernel

由于內核配置中默認開啟了ps PCIe的DMA，為了避免后面安裝外部驅動時沖突，這里需要去掉Xilinx PS PCIe DMA support的默認勾選。

④ 編譯工程

petalinux-build

⑤ 打包文件

petalinux-package --boot --fsbl zynqMP_fsbl --u-boot u-boot.elf --force

生成BOOT.BIN、image.ub、boot.scr等關鍵啟動文件。將上述生成的啟動文件復制到SD卡的boot分區。

2.3 編譯移植PS PCIE DMA驅動（RC端）

① 獲取并修改驅動源碼：從Xilinx Wiki獲取驅動源碼。由于官方提供的驅動源碼是在X86 host上編譯執行的，還需要將其修改為可在ARM上執行的ko文件，即交叉編譯。

② 修改Makefile，將KERNEL_DIR指定為本地內核代碼所在路徑。內核路徑示例（請根據實際路徑修改）：

/home/your_user_name/petalinux_pro/peta_2021/zcu102_rc/build/tmp/work/zynqmp_generic-xilinx-linux/linux-xlnx/5.10+gitAUTOINC+568989d441-r0/linux-zynqmp_generic-standard-build。

③ 在驅動源碼目錄執行make命令，成功編譯后會生成ps_PCIe_dma.ko內核模塊文件。

④ 將編譯生成的ko文件、apps路徑下的simple_test應用文件以及petalinux打包好的Boot.bin、image.ub和boot.scr都拷貝至SD。

2.4 硬件準備（EP端）

① vivado配置（類似RC，但關鍵點不同）

a.在IO configuration中明確將PCIe模式設置為Endpoint。

b.關鍵修改，將Device ID修改為“0XA808”。此值必須與驅動源碼中ZYNQMP_DMA_DEVID1定義的預期設備ID嚴格匹配，否則驅動無法正常運行。

② 生成并導出硬件設計。

③ 創建EP端Boot文件，在vitis中：基于導出的.xsa文件新建Vitis平臺工程。創建一個簡單的Hello World應用程序工程（僅用于加載運行基本固件）。將其復制到EP板SD卡。

2.5上板實測

① 上電啟動：

將準備好的SD卡（含boot文件）分別插入兩塊ZCU102。

兩塊板均設置為SD卡啟動模式。

連接RC板的串口到主機終端（如PuTTY或minicom）。

② EP枚舉觀察（RC串口輸出）：

給兩塊板上電。

在RC板的串口終端中，你應該能看到類似XXX：PCI host bridge /PCIe@fd0e0000 ranges：和XXX：PCIe：Link up的日志信息，這表明PCIe鏈路已成功建立并枚舉到EP設備。

③ 加載驅動（RC端命令）：

在RC板的Linux命令行中，進入存放驅動的目錄。

執行：insmod ps_pcie_dma.ko

檢查設備節點：成功加載后，/dev/PCIe（例如/dev/ps_pcie_epdma0)等設備節點應被創建。

④ 運行DMA測試程序（RC端命令）：

執行命令進行傳輸測試（以下僅為示例命令，具體參數需看程序說明）：./simple_test

⑤ 測試結果解讀：

程序運行后，終端會打印傳輸的速度數據。

在我們的測試中（Gen2 x1鏈路）：

RC -> EP（寫入EP內存）：傳輸4MB數據，平均速度約為372MB/s。

EP -> RC（寫入RC內存）：傳輸4MB數據，平均速度約為378MB/s。

本文詳細展示了如何利用兩塊Xilinx Zynq UltraScale+ MPSoC ZCU102開發板，通過配置其PS側PCIe控制器分別作為RC和EP，最終實現了兩者之間基于DMA驅動的高速數據互傳功能。該方案驗證了在MPSoC設計中直接利用片上PCIe資源構建高速點對點鏈路的可行性。

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