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越來越“熱”的芯片,如何降溫?

jf_78421104 ? 來源:Cadence楷登 ? 作者:Cadence楷登 ? 2024-09-27 15:59 ? 次閱讀
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前言

2024 年,AI 的“狂飆突進(jìn)”勢(shì)頭不減,繼 ChatGPT 之后,文生視頻大模型 Sora 的推出更是讓人們看到 AI 的無限可能。然而,隨之而來的能耗問題也不容忽視。國際能源署(IEA)《Electricity 2024——Analysis and forecast to 2026E》的報(bào)告,ChatGPT 每響應(yīng)一個(gè)請(qǐng)求需要消耗 2.9 瓦時(shí),這相當(dāng)于一個(gè) 5 瓦的 LED 燈泡亮 35 分鐘。考慮到每天 90 億次搜索,這將在一年內(nèi)額外消耗近 10 太瓦時(shí)的電力,相當(dāng)于一座小型核電站一年的發(fā)電量。而這些能源消耗的“罪魁禍?zhǔn)住敝唬褪侵?AI 運(yùn)行的芯片。為了保證芯片的高效運(yùn)行,龐大的數(shù)據(jù)中心往往需要消耗大量的電力進(jìn)行冷卻。根據(jù) IEA 的報(bào)告,數(shù)據(jù)中心的電力需求主要來自計(jì)算和冷卻兩個(gè)方面,兩者各占總電力需求的 40%左右。預(yù)計(jì)到 2026 年,全球數(shù)據(jù)中心、加密貨幣和人工智能的電力消耗將在 620 至 1,050 TWh 之間變動(dòng)。

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來源:IEA《Electricity 2024 - Analysis and forecast to 2026》

近年來,為了滿足 5G、AI、汽車電子等新興市場(chǎng)不斷增長的算力需求,芯片的集成度不斷提高,相應(yīng)的功耗也隨之增加。功耗增加會(huì)產(chǎn)品熱量,當(dāng)熱度達(dá)到一定程度,芯片輕則宕機(jī),重則損毀。一個(gè)直觀的生活案例,這就好比我們的手機(jī),過熱會(huì)直接死機(jī)。因此芯片散熱已是當(dāng)今工程師的“必修課”。但為了滿足便攜性和美觀性需求,電子設(shè)備的尺寸又必須不斷減小,這就導(dǎo)致給散熱系統(tǒng)留下的空間愈發(fā)有限。如何高效散熱,已成為整個(gè)行業(yè)亟待解決的關(guān)鍵問題。

01 電子系統(tǒng)散熱:日益嚴(yán)峻的挑戰(zhàn)

隨著芯片制程的不斷微縮,大大加劇了散熱困境。按照傳統(tǒng)散熱經(jīng)驗(yàn),芯片的散熱密度存在物理極限,每平方毫米芯片的散熱能力約為 1 瓦。目前行業(yè)內(nèi)的發(fā)展趨勢(shì)是,進(jìn)入 10納米以下,英特爾AMD 等芯片巨頭紛紛采用均熱片來解決發(fā)熱問題。3 納米和 2 納米甚至是埃米時(shí)代的來臨,散熱將是頭等大事。

在人工智能浪潮的推動(dòng)下,下一代 AI 芯片,其功耗甚至超過 1 千瓦。面對(duì)如此高功耗,液冷技術(shù)成為必要的降溫選擇。然而,設(shè)備越熱,其冷卻成本也隨之增加。CDCC的統(tǒng)計(jì)數(shù)據(jù)顯示,數(shù)據(jù)中心的制冷系統(tǒng)在資本支出(CAPEX)中占 20-25%,在運(yùn)營支出(OPEX)中的電力成本更是占了 40%。

功耗曾經(jīng)被視為軟性指標(biāo),但現(xiàn)在已成為芯片設(shè)計(jì)中的重要考量因素。過高的熱量帶來的不良影響不容忽視:

性能下降:過高的溫度會(huì)導(dǎo)致芯片性能下降,甚至出現(xiàn)死機(jī)、藍(lán)屏等故障。

可靠性降低:高溫會(huì)加速電子元件的老化,縮短設(shè)備的使用壽命。

安全性隱患:極端情況下,過熱可能引發(fā)火災(zāi)等安全事故。

能源浪費(fèi):過多的電力消耗不僅增加了運(yùn)營成本,還加劇了能源危機(jī)。

熱量不僅會(huì)影響單個(gè)電子元件的性能,還會(huì)對(duì)整個(gè)電子系統(tǒng)的可靠性造成威脅。以現(xiàn)代汽車為例,在汽車電動(dòng)化、智能化和網(wǎng)聯(lián)化的發(fā)展趨勢(shì)下,車內(nèi)集成了成百上千個(gè)電子元件,這些元件之間相互作用產(chǎn)生的熱量和振動(dòng),會(huì)形成復(fù)雜的熱應(yīng)力和機(jī)械應(yīng)力場(chǎng),影響設(shè)備的穩(wěn)定性和可靠性。

面對(duì)日益嚴(yán)峻的散熱挑戰(zhàn),以及對(duì)芯片性能提升的孜孜以求,如何在保證芯片性能的前提下,有效解決散熱問題,是擺在業(yè)界面前的一項(xiàng)緊迫任務(wù)。

EDA 的角度來看,要實(shí)現(xiàn)精準(zhǔn)的熱分析面臨著諸多挑戰(zhàn)。首先,熱量在芯片內(nèi)的傳播路徑復(fù)雜多樣,需要考慮不同材料的熱導(dǎo)率、界面熱阻等因素。其次,對(duì)于 3D-IC 等先進(jìn)封裝技術(shù),需要考慮不同層次之間的熱傳導(dǎo)和散熱路徑,這增加了分析的復(fù)雜性和計(jì)算的負(fù)擔(dān)。此外,由于熱仿真的精度要求高,需要考慮如何在保證計(jì)算效率的同時(shí),不影響分析結(jié)果的準(zhǔn)確性。

然而,當(dāng)前市場(chǎng)上的熱分析工具往往是零散的且功能單一,工程師需要同時(shí)使用多個(gè)不同的軟件和方法來完成散熱設(shè)計(jì),這增加了工程開發(fā)周期和成本,同時(shí)降低了設(shè)計(jì)的效率和一致性。傳統(tǒng)的電子散熱設(shè)計(jì)和分析工具已顯得力不從心。

因此,電子行業(yè)亟需要?jiǎng)?chuàng)新的方法和工具來為芯片“降溫”。這種解決方案應(yīng)具備以下特點(diǎn):

早期評(píng)估:在設(shè)計(jì)初期就對(duì)熱解決方案進(jìn)行評(píng)估,積極利用數(shù)字孿生等創(chuàng)新技術(shù),避免后期返工。通過采用“左移”開發(fā)策略,即在設(shè)計(jì)早期引入熱分析,我們可以更早地發(fā)現(xiàn)并解決潛在的熱問題,從而提高產(chǎn)品的可靠性。

全局入手:將整個(gè)電子系統(tǒng)作為一個(gè)整體進(jìn)行熱分析,考慮各組件之間的相互作用。

統(tǒng)一平臺(tái):提供一個(gè)集成的設(shè)計(jì)環(huán)境,涵蓋熱仿真、流體仿真等多種分析功能。

02 Cadence Celsius Studio:開啟散熱設(shè)計(jì)新時(shí)代

今年初,Cadence 以其一貫的創(chuàng)新精神,推出了一款真正的系統(tǒng)級(jí)熱分析工具——Cadence Celsius Studio,它結(jié)合有限元分析(FEA)與計(jì)算流體力學(xué)(CFD)技術(shù),為電子行業(yè)日益嚴(yán)峻的散熱問題提供了一套全面的解決方案。作為業(yè)界首個(gè)將 AI 技術(shù)與熱設(shè)計(jì)深度融合的綜合性平臺(tái),Celsius Studio 打破了傳統(tǒng)熱分析工具的局限,將電熱協(xié)同仿真、電子元件冷卻和熱應(yīng)力分析整合到一個(gè)綜合的平臺(tái),引領(lǐng)電子系統(tǒng)熱設(shè)計(jì)邁向一個(gè)全新的智能化時(shí)代。

Cadence Celsius Studio 實(shí)現(xiàn)了多項(xiàng)突破

01 真正的熱系統(tǒng)分析

在 Cadence Celsius Studio 中,熱和應(yīng)力的建模是通過有限元分析(FEA)來完成的,通過精細(xì)到粗略的網(wǎng)格設(shè)計(jì),可以滿足廣泛的精度需求。在 Cadence Celsius EC Solver 中,工程師可以通過建模對(duì)流和/或主動(dòng)冷卻(如風(fēng)扇等),來實(shí)現(xiàn)散熱分析。

02 AI 驅(qū)動(dòng),實(shí)現(xiàn)設(shè)計(jì)優(yōu)化

當(dāng)今的高性能電子系統(tǒng)要求設(shè)計(jì)人員考慮 SI、PI 和熱完整性以及電磁干擾和兼容性(EMI/EMC)等問題,多物理場(chǎng)分析變得至關(guān)重要。Celsius Studio 中所搭載的 Cadence Optimality Intelligent System Explorer,是一款 AI 驅(qū)動(dòng)的多物理場(chǎng)優(yōu)化軟件,它突破了傳統(tǒng)人力密集型優(yōu)化流程的限制,用 AI 驅(qū)動(dòng)的技術(shù)取代了傳統(tǒng)的設(shè)計(jì)-測(cè)試-優(yōu)化循環(huán)的交互流程,可對(duì)整個(gè)設(shè)計(jì)空間進(jìn)行快速高效的探索,鎖定理想設(shè)計(jì)。

人工智能技術(shù)的引入,為電子設(shè)計(jì)自動(dòng)化帶來了革命性的變革。Celsius Studio 不僅能幫助工程師在設(shè)計(jì)早期階段發(fā)現(xiàn)熱問題,還可提供分析和設(shè)計(jì)洞察,預(yù)測(cè)潛在的熱問題,并提供智能化的優(yōu)化建議,盡可能減少機(jī)械工程團(tuán)隊(duì)的后期設(shè)計(jì)迭代,縮短電子系統(tǒng)的開發(fā)迭代周期。Celsius Studio 專為大規(guī)模并行執(zhí)行而設(shè)計(jì),經(jīng)過生產(chǎn)驗(yàn)證,其可在不犧牲精度的前提下,與手動(dòng)、詳盡、強(qiáng)力的參數(shù)表研究相比,生產(chǎn)力平均提高 10 倍。

計(jì)算流體動(dòng)力學(xué)(CFD)是多物理系統(tǒng)分析的一個(gè)方面,它使用數(shù)值模型模擬流體的行為及其熱力學(xué)特性。

03 打通電氣工程師和機(jī)械工程師的“鴻溝”

隨著 PCB 機(jī)械外殼尺寸日益減小以及 PCB 本身復(fù)雜性的增加,電氣和機(jī)械工程師之間的協(xié)作對(duì)于芯片和系統(tǒng)的熱分析和優(yōu)化愈發(fā)重要。從電路板的輪廓到最終布局和布線,雙方必須掌握相同的信息,彼此同步進(jìn)行,并消除過程中的冗余。

為了進(jìn)行這種分析,ECAD(電子計(jì)算輔助設(shè)計(jì))+ MCAD(機(jī)械計(jì)輔助設(shè)計(jì))的協(xié)作必不可少。MCAD 和 ECAD 之間的無縫集成曾經(jīng)是導(dǎo)致分析速度慢的主要障礙之一。在 Celsius Studio 中,Cadence內(nèi)部的專家簡(jiǎn)化了 MCAD和 ECAD模型的導(dǎo)入過程,將之前幾天的工作量大大縮短到幾乎無感知的時(shí)間,使得電路板和機(jī)架內(nèi)的熱、應(yīng)力和冷卻分析變得更加高效和簡(jiǎn)便。

Celsius Studio 平臺(tái)既面向電氣工程師,也可以滿足機(jī)械工程師的需求。對(duì)于電氣工程師,Celsius Thermal Solver 可進(jìn)行芯片/SoC 性能/熱分析、封裝和 PCB 的電熱協(xié)同仿真,以及在兼顧熱影響的同時(shí)進(jìn)行封裝/PCB 的元件擺放。對(duì)于熱工程師,Celsius Electronics Cooling 提供了電子元件冷卻散熱分析,可通過添加散熱器、風(fēng)扇、通風(fēng)口來緩解潛在的熱問題。

04 多平臺(tái)無縫集成,眾人拾柴火焰高

Celsius Studio 的強(qiáng)大之處在于,可以與 Cadence 的多種實(shí)現(xiàn)平臺(tái)無縫集成,包括 Allegro X Design Platform(用于電路板設(shè)計(jì))、AWR Design Environment(用于微波 IC)、Virtuoso System Design Platform(用于定制/模擬電路)和 Innovus Implementation System(用于數(shù)字電路),芯片散熱是一個(gè)復(fù)雜的工程性問題。Cadence 正在集結(jié)過往幾十年的經(jīng)驗(yàn),將更多的工具整合在一起,助力熱分析更加便捷。

這些多工具的見解可指導(dǎo)電源整體熱和應(yīng)力分析以及熱量減少策略、布局優(yōu)化以及熱通孔和溫度傳感器布局,讓電氣和機(jī)械/熱工程師可以在同一個(gè)環(huán)境中對(duì)設(shè)計(jì)裝配流程執(zhí)行多階段分析,解決單個(gè)封裝上多晶粒堆疊的 3D-IC 翹曲問題,無需對(duì)幾何體進(jìn)行簡(jiǎn)化或轉(zhuǎn)換。

Celsius Studio 正在成為電子行業(yè)解決熱設(shè)計(jì)難題的首選工具,幫助企業(yè)提高產(chǎn)品競(jìng)爭(zhēng)力,加速產(chǎn)品創(chuàng)新。

通過采用 Celsius Studio,三星半導(dǎo)體在設(shè)計(jì)早期階段即獲得了準(zhǔn)確的熱分析結(jié)果,顯著提升了 3D-IC 和 2.5D 封裝的設(shè)計(jì)效率,將產(chǎn)品開發(fā)周期縮短了 30%。

BAE Systems 利用 Celsius Studio 在 MMIC 設(shè)計(jì)周期內(nèi)實(shí)現(xiàn)了快速、準(zhǔn)確的熱分析,大幅提升了 RF 和熱功率放大器的性能。

Celsius Studio 幫助 Chipletz 的設(shè)計(jì)團(tuán)隊(duì)能夠及早獲取詳細(xì)信息,解決散熱問題,并顯著縮短了周轉(zhuǎn)時(shí)間。在 Chipletz 工程團(tuán)隊(duì)開發(fā)復(fù)雜設(shè)計(jì)時(shí),能夠多次高效且詳細(xì)地運(yùn)行 3D-IC 和 2.5D 封裝的熱仿真。

總的來說,Cadence的 Celsius Studio為芯片、封裝、電路板和終端系統(tǒng)提供全方位的熱分析和優(yōu)化提供了一種獨(dú)辟蹊徑的做法

結(jié)語

Cadence Celsius Studio 的推出,為當(dāng)今電子行業(yè)的發(fā)展帶來了全新的機(jī)遇。通過將人工智能與傳統(tǒng)仿真技術(shù)相結(jié)合,Celsius Studio 將幫助工程師克服日益嚴(yán)峻的散熱挑戰(zhàn),加速創(chuàng)新產(chǎn)品的上市。通過提供精確的熱仿真和高效的設(shè)計(jì)優(yōu)化功能,Celsius Studio 將成為電子工程師的得力助手,助力他們?cè)O(shè)計(jì)出更高性能、更可靠的電子產(chǎn)品。

關(guān)于 Cadence

Cadence 是電子系統(tǒng)設(shè)計(jì)領(lǐng)域的關(guān)鍵領(lǐng)導(dǎo)者,擁有超過 30 年的計(jì)算軟件專業(yè)積累。基于公司的智能系統(tǒng)設(shè)計(jì)戰(zhàn)略,Cadence 致力于提供軟件、硬件和 IP 產(chǎn)品,助力電子設(shè)計(jì)概念成為現(xiàn)實(shí)。Cadence 的客戶遍布全球,皆為最具創(chuàng)新能力的企業(yè),他們向超大規(guī)模計(jì)算、5G 通訊、汽車、移動(dòng)設(shè)備、航空、消費(fèi)電子、工業(yè)和醫(yī)療等最具活力的應(yīng)用市場(chǎng)交付從芯片、電路板到完整系統(tǒng)的卓越電子產(chǎn)品。Cadence 已連續(xù)十年名列美國財(cái)富雜志評(píng)選的 100 家最適合工作的公司。如需了解更多信息,請(qǐng)?jiān)L問公司網(wǎng)站 www.cadence.com。

來源:微信-Cadence楷登

審核編輯 黃宇

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    高速先生成員--黃剛 毫無疑問,信號(hào)速率已經(jīng)是灰常灰常高了,過孔對(duì)信號(hào)質(zhì)量的影響在以往文章中已經(jīng)分享過太多太多。過孔一身都是坑,其中最大的那個(gè)就是它的stub影響。一個(gè)有stub的過孔衰減的上限可能是大家想象不到的,1dB,5dB,10dB,20dB甚至更大都有可能。 So,一套專門為提升有stub的過孔性能的加工工藝就應(yīng)運(yùn)而生了,那就是背鉆,簡(jiǎn)單的流程就像下面這樣了。 當(dāng)然,我們也知道,本身常規(guī)的板子是不需要背鉆的,突然增加這樣一個(gè)工藝流程,加錢是難免的事情。因此精明的硬件朋友們就學(xué)會(huì)了根據(jù)高速信號(hào)速率的不同來決定是否需要背鉆和哪些層背鉆,哪些層就不用背鉆了。簡(jiǎn)單定性來說就是,速率低就能允許過孔的stub長,速率高就需要stub短,當(dāng)然高速先生在很多場(chǎng)合上也大概把速率和stub長度的關(guān)系量化過,還不知道的粉絲可以去問問身邊知道的同事了,哈哈。 由于多一層背鉆,就要多花一層的錢,所以大多數(shù)客戶都會(huì)覺得在不算非常高的速率下,例如25Gbps左右,可能超過25mil以上stub的過孔才會(huì)去背鉆。例如下面的連接器過孔案例,在這一層出線層的情況下,過孔stub是25mil。 這個(gè)時(shí)候我們來考慮背鉆和不背鉆的影響,背鉆后留下的stub是10mil,模型的示意圖如下所示: 然后從結(jié)果上看差異是非常明顯的,TDR阻抗差異超過10個(gè)歐姆,回波損耗也差了接近10個(gè)dB。說明背鉆工藝對(duì)過孔性能的改善幫助很大很大。。。 從上面的結(jié)果能看到,25mil不背鉆結(jié)果當(dāng)然不是很好,背鉆之后哪怕剩下10mil其實(shí)結(jié)果都能接近完美了,看起來的確和我們想象的一樣,如果本身就只有10mil的stub,那還背鉆個(gè)啥,又省錢又不會(huì)為難板廠,一舉兩得! 那問題來了,如果真的只有10mil的stub的話,到底值不值得背鉆呢?那我們把上面那個(gè)模型的走線層換到更靠下的層去走,過孔的stub就10mil出頭的樣子,如下所示: 在不背鉆的情況下,仿真得到的TDR阻抗結(jié)果是85歐姆左右,感覺還行啊,能接受! 這個(gè)時(shí)候我們來硬要板廠幫我們做背鉆,本來是10mil出頭,讓板廠鉆掉幾個(gè)mil,保證最后是8mil的stub,就像下面這個(gè)動(dòng)圖展示的背鉆過程一樣! 最后做出來的這個(gè)效果就是背鉆后剩下8mil stub的模型了。 無非也只是少了3mil左右的stub,能比不背鉆好多少,能差出0.5歐姆都頂天了吧。這下恐怕要讓大家失望了,背鉆后過孔的阻抗從不背鉆的85歐姆左右提升到快接近90歐姆了,足足差不多有5歐姆的提升!!! 這。。。就有點(diǎn)驚掉下巴了啊,就差幾個(gè)mil的stub,能差出快5歐姆的情況?中間是不是有什么誤會(huì)啊? 誤會(huì)可能沒有,認(rèn)知不同是有的。我猜你們認(rèn)為的只差3個(gè)mil的stub長度說的是下面這種情況,那就是把底層焊盤去掉,僅減小過孔stub長度的這個(gè)模型吧? 的確如你們之前想象的一樣,如果只減小過孔stub長度的話,8mil的stub和10mil多的stub對(duì)過孔阻抗的影響的確微乎其微,可能0.2歐姆都沒有! 從三者回波損耗的結(jié)果對(duì)比也能看到幾個(gè)結(jié)論:不背鉆的影響在25Gbps之前性能差別的確不大,但是在25Gbps之后其實(shí)惡化是很厲害的。哪怕只鉆掉焊盤,不減小過孔stub的改善也是非常明顯的,還有就是從結(jié)果來看,單純只差幾個(gè)mil的stub影響是非常小的哈。 這種小于10mil的過孔stub的背鉆我們?cè)赑CB加工行業(yè)內(nèi)就稱為淺背鉆,如下圖所示,淺背鉆主要就是為了去掉底層焊盤的影響,其次才是希望讓stub再短幾個(gè)mil。 最后總結(jié)下哈:這個(gè)地方的影響無論是從SI性能還是加工方面看,都很容易被忽略,尤其當(dāng)我們的通道走到了像112Gbps以上的超高速率下,影響是不小的。同時(shí)對(duì)于板廠加工也是會(huì)增加一丟丟難度,畢竟要鉆的過孔深度很短,一不留神就鉆過了或者壓根沒鉆到,所以也需要對(duì)PCB板廠的加工能力有一定的要求哈。我們板廠去做這個(gè)事情當(dāng)然沒有問題,關(guān)鍵是在于各位硬件或者PCB設(shè)計(jì),包括SI的小伙伴們有沒有意識(shí)到這個(gè)地方對(duì)高頻的影響,從而找我們的板廠去做這個(gè)淺背鉆而已! 問題:大家對(duì)自己產(chǎn)品的過孔要不要去做背鉆工藝,都是怎么考慮的啊? 關(guān)于一博: 一博科技成立于2003年3月,深圳創(chuàng)業(yè)板上市公司,股票代碼: 301366,專注于高速PCB設(shè)計(jì)、SI/PI仿真分析等技術(shù)服務(wù),并為研發(fā)樣機(jī)及批量生產(chǎn)提供高品質(zhì)、短交期的PCB制板與PCBA生產(chǎn)服務(wù)。致力于打造一流的硬件創(chuàng)新平臺(tái),加快電子產(chǎn)品的硬件創(chuàng)新進(jìn)程,提升產(chǎn)品質(zhì)量。
    發(fā)表于 08-18 16:30

    LED芯片亮,發(fā)熱量越大,還是芯片暗,發(fā)熱量越大?

    LED芯片亮,發(fā)熱量越大,還是芯片暗,發(fā)熱量越大?遇到這個(gè)問題,相信很多人都會(huì)認(rèn)為是芯片
    的頭像 發(fā)表于 07-21 16:16 ?1197次閱讀
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    后摩爾時(shí)代:芯片不是越來越涼,而是越來越

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    的頭像 發(fā)表于 07-12 11:19 ?1920次閱讀
    后摩爾時(shí)代:<b class='flag-5'>芯片</b>不是<b class='flag-5'>越來越</b>涼,而是<b class='flag-5'>越來越</b>燙

    這些顛覆想象的降溫黑科技

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    的頭像 發(fā)表于 07-07 12:45 ?1178次閱讀

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    本文由半導(dǎo)體產(chǎn)業(yè)縱橫(ID:ICVIEWS)編譯自semiengineering過去,仿真曾是驗(yàn)證的唯一工具,但如今選擇已變得多樣。平衡成本與收益并非易事。芯片首次流片成功率正在下降,主要原因
    的頭像 發(fā)表于 06-05 11:55 ?944次閱讀
    <b class='flag-5'>芯片</b>的驗(yàn)證為何<b class='flag-5'>越來越</b>難?

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    的頭像 發(fā)表于 04-25 16:26 ?7623次閱讀
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    發(fā)表于 03-12 09:43