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如何利用電容和電感縮小PCB版面

PCB線路板打樣 ? 來源:CSDN 博主 ? 作者:死線 ? 2020-12-10 15:41 ? 次閱讀
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通過電容,電感的匹配縮減一半的PCB版面

介紹了低噪放的設計和原理圖版圖聯(lián)合仿真,但是生成的版圖比較大,占用了大量空間,接下來會用電容和電感來做匹配網絡,縮短微帶,節(jié)省空間。優(yōu)化后的版圖

通過電容,電感的匹配縮減了一半的版面。原理圖版圖聯(lián)合仿真仿真模型如下

VD9DTpzB5w7e9vqvgd13pgjgqkyq9007u7m5eo2d.jpg

仿真結果如下

fsa12hRbxwccqrx2o08d1b2k2votyv2u7sr9uh06.jpg

PCB版圖生成實際中生產的PCB版圖一般使用Altium Designer,PADSCadence allegro三種制版軟件設計。
接下來將使用Altium Designer生成PCB版圖。
原理圖如下
按照ADS的電路圖布置原理圖,同時調整一下位號,元器件數值

9hDAW8HG9xpvrlhhcicuybwmz3mv7dowf7j90guu.jpg

PCB版圖如下
2D視圖

3D視圖

編輯:hfy

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