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模擬提示:ADC抽取

電子設計 ? 來源:電子設計 ? 作者:電子設計 ? 2020-10-12 01:14 ? 次閱讀
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來源:互聯網

寬帶 GSPS 模數轉換器(ADC)使高速采集系統具備很多性能優勢。這類 ADC 提供寬頻譜的可見性。然而,雖然有些應用需要寬帶前端,但也有一些應用要求能夠濾波并調諧到更窄的頻譜。

當需要窄帶時,ADC 采樣、處理并消耗功率傳輸寬帶頻譜的效率很低。沒有必要在后期處理中使用大量 FPGA 收發器來抽取和過濾寬帶數據。高性能 GSPS ADC 讓數字下變頻(DDC)進駐到 ADC 內部。減少 JESD204B ADC 輸出通道數可以最大限度地降低數據速率和系統布局的復雜度。

抽取是一種僅觀察 ADC 采樣樣本的周期性部分,而忽略其余部分的方法。抽取的結果是降低 ADC 的采樣速率。例如,1/4 抽取模式意味著(總樣本數)/4,有效地拋棄所有其他樣本。

ADC 還必須包含數控振蕩器(NCO)和一個濾波和混頻元件(用作抽取功能的配對器件)。數字濾波有效地消除了由抽取率設定的狹義帶寬的帶外噪聲。作為本振的 NCO 的數字調諧字提供采樣速率的小數分頻,通過分辨率位數提供精確定位。調諧字具有范圍和分辨率,可以將濾波器按頻譜放置在需要的地方。

濾波器的通帶應與抽取后的轉換器的有效頻譜寬度相匹配。使用 DDC 的顯著優勢是能夠定位基本信號的諧波,使其落在目標頻段以外。

DDC 濾波器的數字濾波可濾除較窄帶寬之外的噪聲。理想 ADC 的 SNR 計算必須考慮過濾噪聲的處理增益。使用一個完美的數字濾波器,帶寬每減少 2 次冪,因過濾噪聲而產生的處理增益就會增加 3dB。

理想的 SNR(包括處理增益)=

6.02 × N + 1.76 dB + 10log10(fs/(2 × BW))

審核編輯 黃昊宇

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