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      電子發燒友網>電子資料下載>電子論文>數字信號處理論文>異步時序亞穩態的消除方法設計

      異步時序亞穩態的消除方法設計

      2011-05-31 | pdf | 511 KB | 次下載 | 免費

      資料介紹

      ?

      提出一種基于異步比較法產生空滿標志位，并利用鎖存器實現標志位與時鐘同步的FIFO，同時還給出了相應的VerilogHDL代碼。該方法能提高時鐘頻率，節約版圖面積。

      設計 亞穩態 時序 異步 穩態 方法 異步時序 消除方法 消除
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