資料介紹
74ALVCH16841 有兩個 10 位 D 型鎖存器,每個鎖存器都有獨立的 D 型輸入 以及用于總線導向應用的 3 態(tài)輸出。每個寄存器的兩個部分都受到控制 獨立地由鎖存使能 (nLE) 和輸出使能 (nOE) 控制門控制。 當nOE為低電平時,寄存器中的數(shù)據(jù)出現(xiàn)在輸出端。當 nOE 為高時, 輸出處于高阻抗關閉狀態(tài)。nOE 輸入的操作不會影響 人字拖。 74ALVCH16841 具有有源總線保持電路,用于保持未使用或浮動 有效邏輯級別的數(shù)據(jù)輸入。此功能消除了對外部上拉或下拉的需要 電阻。 2. 特點和優(yōu)勢 • 1.2 V 至 3.6 V 的寬電源電壓范圍 • CMOS低功耗 • 與TTL電平直接接口 • VCC = 3.0 V 時電流驅動 ±24 mA • MULTIBYTE™ 直通式標準引腳架構 • • 所有數(shù)據(jù)輸入都有總線保持 • 輸出驅動能力:85 °C 下 50 Ω傳輸線 • • 符合JEDEC標準: 3 態(tài)同相輸出,適用于總線導向應用 低電感多個 VCC 和 GND 引腳,可較大限度地降低噪聲和接地反彈 • • JESD8-5(2.3 V至2.7 V) JESD8B/JESD36(2.7 V至3.6 V) • ESD 保護: • HBM:ANSI/ESDA/JEDEC JS-001 2 類超過 2000 V • CDM:ANSI/ESDA/JEDEC JS-002 C3 類超過 1000 V
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