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噪聲對高性能模擬電路設(shè)計人員來說是一個極其重要的參 數(shù)。對高速時鐘、模數(shù)轉(zhuǎn)換器 (ADC)、數(shù)模轉(zhuǎn)換器 (DAC)、電壓控制振蕩器(VCO)和鎖相環(huán)(PLL)來說尤其如 此。降低輸出電壓噪聲的關(guān)鍵是保持交流閉環(huán)增益接近單 位增益，且不影響交流性能和直流閉環(huán)增益。 本應(yīng)用筆記描述如何用簡單的RC網(wǎng)絡(luò)降低可調(diào)低壓差穩(wěn)壓 器(LDO)的輸出噪聲。我們將提供針對多個LDO的實驗數(shù) 據(jù)，以展示這一簡單電路技術(shù)的有效性。盡管降噪(NR)是 本應(yīng)用筆記的重點，但同時一些測試數(shù)據(jù)也展示了降噪對 電源抑制比(PSRR)和瞬變負載響應(yīng)的影響。
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