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全加器是數(shù)字信號處理器微處理器中的重要單元，它不僅能完成加法，還能參與減法、乘法、除法等運算，所以，。提高全加器性能具有重要意義。本文分析了兩種普通全加器，運用布爾代數(shù)對全加器和的數(shù)、進位函數(shù)進行全面處理，提取了和麗數(shù)進位兩數(shù)優(yōu)化函數(shù)式。根據(jù)最優(yōu)化函數(shù)式，設計了高性能CMOS管級全加器單元電路。這種CM0S全加器電路與常用CMOS全加器電路相比，電路結構簡單、芯片面積小。電路傳輸延遲時間小，運算速度快。
現(xiàn)代微處理器中運算器是其重要部件，也是各種LSI和VLSI芯片實現(xiàn)實時圖像處理和數(shù)字信號處理的核心。運算器完成一次基本操作周期基本上決定了微處理器的主頻，提高運算器基本操作速度對提高微處理器以及各種LSI和VLSI工作速度具有重要意義。然而，運算器的核心是加法器，全加器是加法器基本單元電路，所以優(yōu)化全加器結構是提高運算器性能最重要途徑之一。對于全加器結構的研究，國內(nèi)外有許多相關報道，本文基于晶體管級討論全加器電路結構的優(yōu)化，提出了一種電路;結構簡單、時延小、芯片面積也小的優(yōu)化CMOS全加器，并對其性能進行了分析。
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