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      電子發(fā)燒友網(wǎng)>電子資料下載>模擬數(shù)字>詳細(xì)介紹通用分頻器基本原理

      詳細(xì)介紹通用分頻器基本原理

      2014-11-07 | doc | 450KB | 次下載 | 1積分

      資料介紹

      在復(fù)雜數(shù)字邏輯電路設(shè)計(jì)中，經(jīng)常會(huì)用到多個(gè)不同的時(shí)鐘信號(hào)。介紹一種通用的分頻器，可實(shí)現(xiàn)2～256之間的任意奇數(shù)、偶數(shù)、半整數(shù)分頻。首先簡(jiǎn)要介紹了FPGA器件的特點(diǎn)和應(yīng)用范圍。接著介紹了通用分頻器的基本原理和分類，并以分頻比為奇數(shù)7和半整數(shù)6.5的分頻器設(shè)計(jì)為例，介紹了在QuartusII開發(fā)軟件下，利用Verilog硬件描述語(yǔ)言來(lái)設(shè)計(jì)數(shù)字邏輯電路的過(guò)程和方法。　　在數(shù)字邏輯電路設(shè)計(jì)中，分頻器是一種基本電路。我們常會(huì)遇到偶數(shù)分頻、奇數(shù)分頻、半整數(shù)分頻等，在同一個(gè)設(shè)計(jì)中有時(shí)要求多種形式的分頻。通常由計(jì)數(shù)器或計(jì)數(shù)器的級(jí)聯(lián)構(gòu)成各種形式的偶數(shù)分頻和奇數(shù)分頻，實(shí)現(xiàn)較為簡(jiǎn)單。但對(duì)半整數(shù)分頻分頻實(shí)現(xiàn)較為困難。但在某些場(chǎng)合下，時(shí)鐘源與所需的頻率不成整數(shù)倍關(guān)系，此時(shí)可采用小數(shù)分頻器進(jìn)行分頻。
      FPGA 分頻器
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