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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>AES算法中S—box和列混合單元的優化及FPGA實現的論文說明

      AES算法中S—box和列混合單元的優化及FPGA實現的論文說明

      2021-01-25 | rar | 0.38 MB | 次下載 | 免費

      資料介紹

      　　由于AES算法的硬件實現較為復雜，在此提出一種優化算法中S—box和列混合單元的方法。其中S—box通過組合和有限域映射的方法進行優化，列混合單元使用算式重組的方法進行優化。這些優化設計通過組合邏輯實現，經過仿真并在Xilinx Spartan 3系列FPGA上進行綜合驗證，可以將結構簡化，使AES電路面積得到優化，明顯節約硬件資源。

      FPGA Xilinx AES
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