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電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>使用FPGA實現數字鐘設計的資料說明

使用FPGA實現數字鐘設計的資料說明

2021-01-19 | rar | 0.99 MB | 次下載 | 免費

資料介紹

  一、實驗目的:

  通過設計實例,深入理解自頂向下設計方法,系統設計規范、系統設計、模塊設計和系統仿真與實現各階段的設計內容,初步掌握規范的數字系統設計方法并實踐。

  二、實驗要求:

  1、系統概述:設計一個用 LED 7段顯示器顯示的24小時制數字鐘。

  2、系統目標:

  (1)用8個LED 顯示時間,如9點25分10秒顯示為,09-25-10。

  (2)設置2個按鍵,按鍵SET用于工作模式選擇,按鍵UP用于設置數值。(可選)

  (3)按SET鍵循環設置工作模式為:正常顯示-》時設置-》分設置-》秒設

  置。在設置工作模式時,被設置相應數字按1秒速率閃爍,其它數字不變。

  (4)在設置工作模式時,按UP鍵一次,被設置相應數字增加1,加到最大值后再加返回0,如小時加到23后再加就返回0,分和秒加到59后再加返回0 。

  3、系統設計依據:

  外部輸入時鐘為40MHZ,通過分頻產生秒脈沖信號,用模60計數器對其計數產生分脈沖信號,對分脈沖用模60計數器對其計數產生時脈沖信號,再用模24計數器對時脈沖計數,即可實現一天24小時的時間信號,通過7段LED數碼管顯示出來則為基本數字鐘,校時電路通過兩個外部異步按鍵對“時”、“分”、“秒”顯示數字進行校對調整。

  4、系統實現要求:

  要求用Mars-EP1C3-EDA實驗平臺。芯片與封裝選擇:本設計用EP1C3T FPGA實現,144腳封裝,輸入輸出為LVTTL電平。

  5、系統驗證及測試要求:

  用Mars-EP1C3-EDA實驗平臺搭建模擬測試平臺測試,測試驗證數字鐘實現設計目標。

FPGA 顯示器 數字鐘
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