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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>CFAR的基本原理和使用FPGA實現CFAR的設計方法概述

      CFAR的基本原理和使用FPGA實現CFAR的設計方法概述

      2020-11-05 | rar | 0.36 MB | 次下載 | 免費

      資料介紹

      　　簡要介紹廣泛應用于雷達信號處理中的恒虛警率（ CFAR） 的基本原理。通過對數據流的分析， 依據CFAR 算法規則簡單的特點， 提出一種基于FPGA 的實現方案， 并詳細介紹用FPGA 實現CFAR 的原理、電路組成和各部分電路的設計方法。

      　　雷達系統通常要求能夠在比熱噪聲更為復雜和不確知的背景環境中檢測目標的存在并保持給定的虛警概率， 為此， 必須采用自適應門限檢測電路。利用自動檢測電路來估測接收機的輸出， 以保持一個恒虛警率的系統便稱為恒虛警率（ CFAR ） 系統。CFAR 技術是雷達自動檢測系統中給檢測策略提供檢測閾值， 其關鍵是選定一個合適的自適應檢測門限來保持目標檢測時虛警概率的恒定， 以期在檢測的“ 虛警”和“漏檢”間尋找到一個最佳平衡點。

      　　實現CFAR 處理， 傳統方案是采用DSP 加軟件的方法實現， 即用通用DSP 芯片構造硬件處理機平臺， 通過編寫處理軟件實現CFAR 算法。這種方案對于距離分辨率不高的寬脈沖雷達來說， 是一種簡單可行的方法， 但對于窄脈沖雷達， 由于距離維采樣頻率很高， 要求處理機硬件平臺提供超高的運算速度， FPGA 以其高的處理速度成為實現CFAR 算法的一種好的選擇。

      　　本文提出一種基于FPGA 的實現方案， 該方案依據CFAR 算法的獨立性、規則性、算法的簡單性和運算密集性等特點， 僅用了一個加法器、兩個乘法器和一個比較器加以實現， 并且通過改變系統中的D 觸發器的級聯數就可實現不同前、后窗長度的處理。

      dsp FPGA 加法器
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