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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>如何設計實現Xilinx FPGA高速串行接口

      如何設計實現Xilinx FPGA高速串行接口

      2020-08-24 | rar | 4.30 MB | 次下載 | 免費

      資料介紹

      　　在數字系統互連設計中，高速串行/O技術取代傳統的并行/O技術成為當前發展的趨勢。與傳統并行丨/技術相比，串行方案提供了更大的帶寬、更遠的距離、更低的成本和更高的擴展能力，克服了并行l/O設計存在的缺陷在實際設計應用中，采用現場可編程門陣列FPGA實現高速串行接口是一種性價比較高的技術途徑。Xi的最新一代FPGA芯片 Virtex5版本，是 /irtex產品線的第五代產品，采用先進的65m三柵極氧化層工藝、新 Expressfabrie技術和 ASMBL架構Virtex.5LXT分別針對高速邏輯、數字信號處理、嵌入式處理和串行連接等應用領域進行優化。與前一代FPGA相比，Ⅵitex-5在性能和密度方面取得了巨大進步：速度平均提高30%，容量增加65%，動態功耗降低35%，靜態功耗保持相同的低水平，占用面積減少45%。Ⅵitex.5LXT芯片內置了最多24個 Rocketio收發器，支持從100Mbps到3.75Gbps串行數據傳輸速率并支持目前流行的高速串行/O接口標準。本文從時鐘、復位、電源控制發送和接收邏輯等關鍵方面，論述了采用vrex.5LXT芯片內的 Rocket-|Oo實現高速串行傳輸接口設計。基于 Xilinx ML505開發平臺實現了高速串行數據傳輸系統，重點說明了 Rocketio特性和1.25Gbps高速串行傳輸的實現技術。

      FPGA 芯片 Xilinx
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