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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于CPLD的LCD1602顯示系統(tǒng)設計與實現(xiàn)

      基于CPLD的LCD1602顯示系統(tǒng)設計與實現(xiàn)

      2015-08-24 | pdf | 3113KB | 次下載 | 免費

      資料介紹

      為了提高LCD1602顯示效果，增強抗擾能力，文章基于TOP2812開發(fā)板，依據(jù)LCD1602操作時序要求，在開發(fā)板CPLD部分實現(xiàn)了LCD1602顯示系統(tǒng)的設計。文中對LCD1602時序進行了詳細分析，并在Quartus II平臺下采用Verilog HDL編寫了test bench測試文件和驅(qū)動程序，經(jīng)仿真和實際測試表明，顯示效果較好，達到了設計要求。
      cpld 1602 時序 顯示系統(tǒng) LCD1602 Verilog HDL
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