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      電子發燒友網>電子資料下載>IC datasheet pdf>SN74HC74-Q1,pdf(Dual D-Type Po

      SN74HC74-Q1,pdf(Dual D-Type Po

      2010-07-29 | rar | 182 | 次下載 | 5積分

      資料介紹

      The SN74HC74 device contains two independent D-type positive-edge-triggered flip-flops. A low level at the preset (PRE) or clear (CLR) inputs sets or resets the outputs, regardless of the levels of the other inputs. When?PRE?and?CLR?are inactive (high), data at the data (D) input meeting the setup time requirements are transferred to the outputs on the positive-going edge of the clock (CLK) pulse. Clock triggering occurs at a voltage level and is not directly related to the rise time of CLK. Following the hold-time interval, data at the D input can be changed without affecting the levels at the outputs.
      Flip-Flop
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