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第四章 #數(shù)字集成電路的速度 4.3 邏輯門延時(shí)模型
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合集?·?【清華大學(xué)】數(shù)字超大規(guī)模集成電路設(shè)計(jì)
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第34集??
第四章 #數(shù)字集成電路的速度 4.3 邏輯門延時(shí)模型
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第35集??
第四章 #數(shù)字集成電路的速度 4.5 組合邏輯電路的速度優(yōu)化(1)
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第36集??
第四章 #數(shù)字集成電路的速度 4.4 CMOS邏輯門的延時(shí)特性(2)
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第37集??
第四章 #數(shù)字集成電路的速度 4.5 組合邏輯電路的速度優(yōu)化(4)
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第38集??
第四章 #數(shù)字集成電路的速度 4.5 組合邏輯電路的速度優(yōu)化(2)
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第39集??
第四章 #數(shù)字集成電路的速度 4.5 組合邏輯電路的速度優(yōu)化(3)
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第40集??
第四章 #數(shù)字集成電路的速度 4.5 組合邏輯電路的速度優(yōu)化(6)
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第41集??
第四章 #數(shù)字集成電路的速度 4.5 組合邏輯電路的速度優(yōu)化(5)
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第42集??
第四章 #數(shù)字集成電路的速度 4.6 總結(jié)
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第43集??
第五章 #數(shù)字集成度的功耗 5.1 引言—集成電路的功耗問題
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第44集??
第五章 #數(shù)字集成度的功耗 5.2 CMOS邏輯門的動(dòng)態(tài)功耗(1)
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第五章 #數(shù)字集成度的功耗 5.2 CMOS邏輯門的動(dòng)態(tài)功耗(2)
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第五章 #數(shù)字集成度的功耗 5.2 CMOS邏輯門的動(dòng)態(tài)功耗(3)
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第五章 #數(shù)字集成度的功耗 5.2 CMOS邏輯門的動(dòng)態(tài)功耗(4)
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第五章 #數(shù)字集成度的功耗 5.3 CMOS邏輯門的靜態(tài)功耗(2)
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第五章 #數(shù)字集成度的功耗 5.3 CMOS邏輯門的靜態(tài)功耗(1)
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第五章 #數(shù)字集成度的功耗 5.3 CMOS邏輯門的靜態(tài)功耗(3)
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第五章 #數(shù)字集成度的功耗 5.4 功耗優(yōu)化技術(shù)(2)
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第六章 #互連線 6.3 互連線的信號(hào)完整性問題(5)
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第六章 #互連線 6.3 互連線的信號(hào)完整性問題(4)
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第七章 #組合邏輯門的設(shè)計(jì) 7.0 引言
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第70集??
第七章 #組合邏輯門的設(shè)計(jì) 7.1 靜態(tài)互補(bǔ)CMOS邏輯的特點(diǎn)
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第七章 #組合邏輯門的設(shè)計(jì) 7.2 有比邏輯(1)
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第72集??
第七章 #組合邏輯門的設(shè)計(jì) 7.2 有比邏輯(2)
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第七章 #組合邏輯門的設(shè)計(jì) 7.2 有比邏輯(3)
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第七章 #組合邏輯門的設(shè)計(jì) 7.2 有比邏輯(4)
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第七章 #組合邏輯門的設(shè)計(jì) 7.3 傳輸管邏輯(2)
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第七章 #組合邏輯門的設(shè)計(jì) 7.3 傳輸管邏輯(1)
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第七章 #組合邏輯門的設(shè)計(jì) 7.4 動(dòng)態(tài)邏輯(1)
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第七章 #組合邏輯門的設(shè)計(jì) 7.4 動(dòng)態(tài)邏輯(4)
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