AD7492、AD7492-4 和 AD7492-5 均為 12 位高速、低功耗、逐次逼近型 ADC。這些器件采用 2.7 V 至 5.25 V 單電源供電，吞吐率高達(dá) 1.25 MSPS。它們包含一個(gè)低噪聲、寬帶寬采樣/保持放大器，可處理高達(dá) 10 MHz 的帶寬。
轉(zhuǎn)換過程和數(shù)據(jù)采集使用標(biāo)準(zhǔn)控制輸入進(jìn)行控制，可輕松連接到微處理器或 DSP。輸入信號(hào)在 CONVST 的下降沿采樣，此時(shí)也開始轉(zhuǎn)換。BUSY引腳在轉(zhuǎn)換開始時(shí)變?yōu)楦唠娖剑⒃?80 ns （AD7492/AD7492-4）或680 ns （AD7492-5）后變?yōu)榈碗娖剑硎巨D(zhuǎn)換完成。沒有與零件關(guān)聯(lián)的管道延遲。轉(zhuǎn)換結(jié)果可通過高速并行接口通過標(biāo)準(zhǔn) CS 和 RD 信號(hào)訪問。
AD7492 采用先進(jìn)的設(shè)計(jì)技術(shù)，可在高吞吐速率下實(shí)現(xiàn)極低的功耗。采用 5 V 電源和 1.25 MSPS 時(shí)，AD7492-5 的平均電流消耗典型值為 2.75 mA。該器件還提供靈活的功率/吞吐率管理。
還可以在完全休眠模式和部分休眠模式下作器件，其中器件被喚醒以進(jìn)行轉(zhuǎn)換，并在轉(zhuǎn)換結(jié)束時(shí)自動(dòng)進(jìn)入休眠模式。睡眠模式的類型由 PS/FS 引腳選擇。
使用這些休眠模式可在較低的吞吞吐量下實(shí)現(xiàn)非常低的功耗值。
該器件的模擬輸入范圍為 0 V 至 REFIN。2.5 V 基準(zhǔn)由內(nèi)部提供，可用于外部參考。轉(zhuǎn)換率由內(nèi)部 clock決定。
特征
- 額定電壓DD 為 2.7 V 至 5.25 V
- 吞吐速率為 1 MSPS—AD7492
- 吞吐速率為 1.25 MSPS—AD7492-5
- 低功耗：
1 MSPS 時(shí)為 4 mW（典型值，3 V 電源）
11 mW（典型值，1 MSPS，5 V 電源時(shí)） - 寬輸入帶寬：
100 kHz 輸入頻率時(shí) SNR 為 70 dB（典型值） - 2.5 V 內(nèi)部基準(zhǔn)
- 片上 CLK 振蕩器
- 靈活的功耗/吞吐率管理
- 無(wú)管道延遲
- 高速并行接口
- 休眠模式：50 nA（典型值）
- 24 引腳 SOIC 和 TSSOP 封裝
產(chǎn)品亮點(diǎn)
- 高吞吐量和低功耗。AD7492-5 提供 1.25 MSPS 吞吐量和 16 mW 功耗。
- 靈活的功耗/吞吐率管理。conversion time 由內(nèi)部 clock決定。該器件還具有兩種休眠模式，即部分休眠和全休眠模式，可在較低的吞通速率下最大限度地提高功率效率。
- 無(wú)管道延遲。該器件具有一個(gè)標(biāo)準(zhǔn)逐次逼近型 ADC，可通過 CONVST 輸入和一次性轉(zhuǎn)換控制精確控制采樣瞬時(shí)。
- 靈活的數(shù)字接口。VDRIVE 功能控制 I/O 數(shù)字引腳上的電壓電平。
- 更少的外圍組件。AD7492 通過使用內(nèi)部基準(zhǔn)和內(nèi)部 CLK 來(lái)優(yōu)化 PCB 空間。
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